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以此类推我们可以得出其他使得输出值为1的条件:
x'yz'w
x'yzw'
x'yzw
xyz'w
然后我们求出五个逻辑表达式的析取可得该逻辑电路的布尔与或式:
x'yz'w+x'yzw'+x'yzw+xy'zw+xyz'w
以上内容中为什么得到其他输出值为1以后就把他们进行一个或的操作就可以得到整个布尔与或式